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SDH E1时隙可配帧格式及数据编码的设计与FPGA实现技术 期刊论文
时间频率学报, 2018, 卷号: 41.0, 期号: 004, 页码: 317
作者:  池飞;  武建锋;  何在民
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SDH  E1  可配时隙  数据编码  帧格式  现场可编程门阵列  
基于E1接口的时间统一系统的研究与设计 学位论文
: 中国科学院研究生院, 2012
作者:  闫辉
Adobe PDF(1288Kb)  |  收藏  |  浏览/下载：337/1  |  提交时间：2012/08/30
时间统一系统  时统设备  E1  Fpga  Hdb3码