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基于FPGA的数字锁相环设计 会议论文
2005年全国时间频率学术交流会文集, 中国西安, 2005
作者:  李小飞
Adobe PDF(295Kb)  |  收藏  |  浏览/下载：69/0  |  提交时间：2012/10/19
数字锁相环  Verilog  Fpga  同步|abstract  本文介绍了数字锁相环的基本工作原理。研究了在数字锁相的基础上实现获取与外标频率同相的编程可变的频率的方法。同时  利用verilog语言完成了该研究的基于fpga芯片的设计实现  并对结果进行了仿真。